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量子コンピュータ関連銘柄 更新: 10/12 15:15(日本時間)
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ソフトウェア・アルゴリズム

大規模フォールトトレラント量子回路シミュレーションのためにNVIDIA GPU高速化を統合したQC Design

要約

QC Designは、量子コンピュータの設計ソフトPlaquetteにNVIDIAの技術を組み込み、性能を大幅に向上させました。従来のCPUでは60量子ビット程度しか扱えなかったところ、GPU1台で400量子ビット以上のシミュレーションが可能になり、処理速度も180倍以上高速化しました。これにより、実用的な量子コンピュータの開発期間とコストの削減が期待されています。

QC Designは、NVIDIAのcuQuantum SDKとの統合により、量子フォールトトレランス設計ソフトウェアPlaquetteにおいて、大幅な性能向上を発表しました。このアップデートではcuTensorNetを活用し、フォールトトレラントな量子回路の高性能なフルステートシミュレーションを実現しています。その結果、Plaquetteは20GBのメモリを搭載したNVIDIA RTX 4000 Ada GPU1台で400量子ビット以上のシミュレーションが可能になりました。これは、120GBのRAMを使用して通常約60量子ビットしかシミュレーションできない現行のCPUベースのモンテカルロシミュレータと比較して改善されています。

GPUによる高速化されたシミュレーションは、大幅な性能向上ももたらしています。Plaquetteは、60量子ビット回路のサンプリング処理能力において、CPUベースの代替手段と比較して少なくとも180倍の高速化を達成しており、現実的なフォールトトレラントアーキテクチャにおけるコヒーレントエラーや振幅減衰などの複雑なエラーモデルのシミュレーションを実現可能にしています。これにより、ハードウェアチームは実用的なフォールトトレラント量子システムの設計に不可欠な、フルステート忠実度での量子エラー訂正プロトコルの正確なモデル化、分析、最適化が可能になります。

Plaquetteは現在、20種類以上のハードウェアの不完全性をモデル化し、文献に記載されている最も広範なフォールトトレランスプロトコルをサポートしています。GPUによる高速化が主要機能として統合されたことで、QC Designは量子ハードウェアチームの開発期間とコストの削減を目指しています。

背景

フォールトトレランスは、量子コンピュータにおいて発生しやすいエラーを訂正し、計算の信頼性を高める技術です。量子ビットは外部の影響を受けやすく誤りが出やすいため、複数の物理的な量子ビットを使って1つの論理的な量子ビットを構成し、エラーを検出・修正する仕組みが求められています。

フルステートシミュレーションは、量子回路内のすべての量子ビットの状態を完全に追跡するシミュレーション手法です。これにより、コヒーレントエラーや振幅減衰といった複雑なエラーモデルを高精度に再現し、量子エラー訂正プロトコルの正確なモデル化や最適化が可能になります。

cuQuantum SDKは、NVIDIAが提供するGPU向けの量子計算用ソフトウェア開発キットです。cuTensorNetを活用することで、GPUの並列処理能力を活かし、従来のCPUベースのシミュレータと比較して大幅な高速化を実現しています。これにより、限られたメモリ環境でも大規模な量子回路のシミュレーションが行えるようになります。

関連する記事としてQC Designが、ハードウェアを考慮した耐障害性シミュレーションを自動化する統合「Plaquette」フレームワークを公開、C12、耐障害性アーキテクチャ開発のためにQC DesignのPlaquetteを採用、QUDORA、イオントラッププロセッサの耐障害性加速のためQC DesignのPlaquetteソフトウェアを採用もあわせてご覧ください。

2025年3月21日

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